backend\A64\emit_a64_packed.cpp: Implement Packed Saturating instructions
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fd01d6fe0a
@ -181,4 +181,84 @@ void EmitA64::EmitPackedSubS16(EmitContext& ctx, IR::Inst* inst) {
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ctx.reg_alloc.DefineValue(inst, a);
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}
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void EmitA64::EmitPackedSaturatedAddU8(EmitContext& ctx, IR::Inst* inst) {
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auto args = ctx.reg_alloc.GetArgumentInfo(inst);
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const ARM64Reg a = EncodeRegToDouble(ctx.reg_alloc.UseScratchFpr(args[0]));
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const ARM64Reg b = EncodeRegToDouble(ctx.reg_alloc.UseFpr(args[1]));
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code.fp_emitter.UQADD(B, a, a, b);
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ctx.reg_alloc.DefineValue(inst, a);
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}
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void EmitA64::EmitPackedSaturatedAddS8(EmitContext& ctx, IR::Inst* inst) {
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auto args = ctx.reg_alloc.GetArgumentInfo(inst);
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const ARM64Reg a = EncodeRegToDouble(ctx.reg_alloc.UseScratchFpr(args[0]));
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const ARM64Reg b = EncodeRegToDouble(ctx.reg_alloc.UseFpr(args[1]));
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code.fp_emitter.SQADD(B, a, a, b);
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ctx.reg_alloc.DefineValue(inst, a);
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}
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void EmitA64::EmitPackedSaturatedSubU8(EmitContext& ctx, IR::Inst* inst) {
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auto args = ctx.reg_alloc.GetArgumentInfo(inst);
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const ARM64Reg a = EncodeRegToDouble(ctx.reg_alloc.UseScratchFpr(args[0]));
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const ARM64Reg b = EncodeRegToDouble(ctx.reg_alloc.UseFpr(args[1]));
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code.fp_emitter.UQSUB(B, a, a, b);
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ctx.reg_alloc.DefineValue(inst, a);
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}
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void EmitA64::EmitPackedSaturatedSubS8(EmitContext& ctx, IR::Inst* inst) {
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auto args = ctx.reg_alloc.GetArgumentInfo(inst);
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const ARM64Reg a = EncodeRegToDouble(ctx.reg_alloc.UseScratchFpr(args[0]));
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const ARM64Reg b = EncodeRegToDouble(ctx.reg_alloc.UseFpr(args[1]));
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code.fp_emitter.SQSUB(B, a, a, b);
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ctx.reg_alloc.DefineValue(inst, a);
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}
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void EmitA64::EmitPackedSaturatedAddU16(EmitContext& ctx, IR::Inst* inst) {
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auto args = ctx.reg_alloc.GetArgumentInfo(inst);
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const ARM64Reg a = EncodeRegToDouble(ctx.reg_alloc.UseScratchFpr(args[0]));
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const ARM64Reg b = EncodeRegToDouble(ctx.reg_alloc.UseFpr(args[1]));
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code.fp_emitter.UQADD(H, a, a, b);
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ctx.reg_alloc.DefineValue(inst, a);
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}
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void EmitA64::EmitPackedSaturatedAddS16(EmitContext& ctx, IR::Inst* inst) {
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auto args = ctx.reg_alloc.GetArgumentInfo(inst);
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const ARM64Reg a = EncodeRegToDouble(ctx.reg_alloc.UseScratchFpr(args[0]));
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const ARM64Reg b = EncodeRegToDouble(ctx.reg_alloc.UseFpr(args[1]));
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code.fp_emitter.SQADD(H, a, a, b);
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ctx.reg_alloc.DefineValue(inst, a);
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}
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void EmitA64::EmitPackedSaturatedSubU16(EmitContext& ctx, IR::Inst* inst) {
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auto args = ctx.reg_alloc.GetArgumentInfo(inst);
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||||
const ARM64Reg a = EncodeRegToDouble(ctx.reg_alloc.UseScratchFpr(args[0]));
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||||
const ARM64Reg b = EncodeRegToDouble(ctx.reg_alloc.UseFpr(args[1]));
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code.fp_emitter.UQSUB(H, a, a, b);
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||||
ctx.reg_alloc.DefineValue(inst, a);
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||||
}
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||||
void EmitA64::EmitPackedSaturatedSubS16(EmitContext& ctx, IR::Inst* inst) {
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auto args = ctx.reg_alloc.GetArgumentInfo(inst);
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||||
const ARM64Reg a = EncodeRegToDouble(ctx.reg_alloc.UseScratchFpr(args[0]));
|
||||
const ARM64Reg b = EncodeRegToDouble(ctx.reg_alloc.UseFpr(args[1]));
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code.fp_emitter.SQSUB(H, a, a, b);
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ctx.reg_alloc.DefineValue(inst, a);
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}
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} // namespace Dynarmic::BackendA64
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@ -203,15 +203,15 @@ OPCODE(PackedSubU16, U32, U32,
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//OPCODE(PackedHalvingAddSubS16, U32, U32, U32 )
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//OPCODE(PackedHalvingSubAddU16, U32, U32, U32 )
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//OPCODE(PackedHalvingSubAddS16, U32, U32, U32 )
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//OPCODE(PackedSaturatedAddU8, U32, U32, U32 )
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//OPCODE(PackedSaturatedAddS8, U32, U32, U32 )
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//OPCODE(PackedSaturatedSubU8, U32, U32, U32 )
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//OPCODE(PackedSaturatedSubS8, U32, U32, U32 )
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//OPCODE(PackedSaturatedAddU16, U32, U32, U32 )
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//OPCODE(PackedSaturatedAddS16, U32, U32, U32 )
|
||||
//OPCODE(PackedSaturatedSubU16, U32, U32, U32 )
|
||||
//OPCODE(PackedSaturatedSubS16, U32, U32, U32 )
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OPCODE(PackedSubS16, U32, U32, U32 )
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OPCODE(PackedSaturatedAddU8, U32, U32, U32 )
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OPCODE(PackedSaturatedAddS8, U32, U32, U32 )
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OPCODE(PackedSaturatedSubU8, U32, U32, U32 )
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||||
OPCODE(PackedSaturatedSubS8, U32, U32, U32 )
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OPCODE(PackedSaturatedAddU16, U32, U32, U32 )
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||||
OPCODE(PackedSaturatedAddS16, U32, U32, U32 )
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||||
OPCODE(PackedSaturatedSubU16, U32, U32, U32 )
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OPCODE(PackedSaturatedSubS16, U32, U32, U32 )
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//OPCODE(PackedAbsDiffSumS8, U32, U32, U32 )
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//OPCODE(PackedSelect, U32, U32, U32, U32 )
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@ -258,18 +258,18 @@ INST(arm_USUB8, "USUB8", "cccc01100101nnnndddd11111111mmmm
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INST(arm_USUB16, "USUB16", "cccc01100101nnnndddd11110111mmmm") // v6
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// Parallel Add/Subtract (Saturating) instructions
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//INST(arm_QADD8, "QADD8", "cccc01100010nnnndddd11111001mmmm") // v6
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//INST(arm_QADD16, "QADD16", "cccc01100010nnnndddd11110001mmmm") // v6
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INST(arm_QADD8, "QADD8", "cccc01100010nnnndddd11111001mmmm") // v6
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||||
INST(arm_QADD16, "QADD16", "cccc01100010nnnndddd11110001mmmm") // v6
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||||
//INST(arm_QASX, "QASX", "cccc01100010nnnndddd11110011mmmm") // v6
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//INST(arm_QSAX, "QSAX", "cccc01100010nnnndddd11110101mmmm") // v6
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||||
//INST(arm_QSUB8, "QSUB8", "cccc01100010nnnndddd11111111mmmm") // v6
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||||
//INST(arm_QSUB16, "QSUB16", "cccc01100010nnnndddd11110111mmmm") // v6
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//INST(arm_UQADD8, "UQADD8", "cccc01100110nnnndddd11111001mmmm") // v6
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//INST(arm_UQADD16, "UQADD16", "cccc01100110nnnndddd11110001mmmm") // v6
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INST(arm_QSUB8, "QSUB8", "cccc01100010nnnndddd11111111mmmm") // v6
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||||
INST(arm_QSUB16, "QSUB16", "cccc01100010nnnndddd11110111mmmm") // v6
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INST(arm_UQADD8, "UQADD8", "cccc01100110nnnndddd11111001mmmm") // v6
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INST(arm_UQADD16, "UQADD16", "cccc01100110nnnndddd11110001mmmm") // v6
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//INST(arm_UQASX, "UQASX", "cccc01100110nnnndddd11110011mmmm") // v6
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//INST(arm_UQSAX, "UQSAX", "cccc01100110nnnndddd11110101mmmm") // v6
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//INST(arm_UQSUB8, "UQSUB8", "cccc01100110nnnndddd11111111mmmm") // v6
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//INST(arm_UQSUB16, "UQSUB16", "cccc01100110nnnndddd11110111mmmm") // v6
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INST(arm_UQSUB8, "UQSUB8", "cccc01100110nnnndddd11111111mmmm") // v6
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INST(arm_UQSUB16, "UQSUB16", "cccc01100110nnnndddd11110111mmmm") // v6
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// Parallel Add/Subtract (Halving) instructions
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//INST(arm_SHADD8, "SHADD8", "cccc01100011nnnndddd11111001mmmm") // v6
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